Thursday 24 May 2018

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germanUVM Online Training

First Steps with UVM - In Deutsch

Format: Live online training event
Duration: 1 hour
Cost: FREE!
Registration: Recording Available (see below - registration required)

Webinar Übersicht:

John AynsleyIndem wir gemeinsam mit ihnen durch funktionierenden UVM-Code gehen, erklären was im Einzelnen abläuft, sowie bewährte Musterlösungen, wie auch die bekannten Fallstricke deutlich machen, möchten wir sie ermutigen, selbst mit der UVM zu beginnen. Wir zeigen ihnen, wie sie ihren UVM-Code am besten strukturieren und ihn auf bekannten SystemVerilog-Simulatoren laufen lassen können. Dabei präsentieren wir ihnen auch einige einfache Beispiele für generelle UVM-Bausteine, die sie einfach kopieren und als Start-Lösung für ihre eigenen Verifikations-Umgebungen benutzen können. (Sie bekommen Gelegenheit, die Code-Beispiele nach der Veranstaltung aus dem Web herunterzuladen).

Der Doulos Zertifizierte Trainer, Dr. Christoph Suehnel, leitet dieses Live-Trainings-Webinar.

Inhaltsübersicht:

Einführung der Begriffe DUT, Interface, Testbench und TestKomponenten und PhasenTypen von UVM componentsKopplung von Testbench und DUTStrukturierung des UVM-Source-CodesTestablaufGenerierung von Sequenzen mittels TransactionsBeenden von Tests

In Deutsch:
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In Englisch:
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In Französisch:
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Rückfragenstellen sie bitte über info@doulos.com



Was ist ‚Easier UVM‘?
‚Easier UVM‘ ist ein Satz von Richtlinien zum Erlernen und für die Anwendung der UVM, der ‚Universal Verification Methodology‘ für SystemVerilog. Sie ist mehr für den Durchschnitts-Entwickler, der in die Verifikation einsteigen will gedacht, als für den Verifikations-Spezialisten.



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